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Logical Effort Designing Fast CMOS Circuits

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Beschreibung

Produktdetails

Einband

Taschenbuch

Erscheinungsdatum

01.02.1999

Verlag

Elsevier Inc

Seitenzahl

258

Maße (L/B/H)

23.3/18.8/1 cm

Gewicht

408 g

Sprache

Englisch

ISBN

978-1-55860-557-2

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Taschenbuch

Erscheinungsdatum

01.02.1999

Verlag

Elsevier Inc

Seitenzahl

258

Maße (L/B/H)

23.3/18.8/1 cm

Gewicht

408 g

Sprache

Englisch

ISBN

978-1-55860-557-2

Herstelleradresse

Libri GmbH
Europaallee 1
36244 Bad Hersfeld
DE

Email: gpsr@libri.de

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  • 1 The Method of Logical Effort2 Design Examples3 Deriving the Method of Logical Effort4 Calculating the Logical Effort of Gates5 Calibrating the Model6 Asymmetric Logic Gates7 Unequal Rising and Falling Delays8 Circuit Families9 Forks of Amplifiers10 Branches and Interconnect11 Wide Structures12 ConclusionsA Cast of CharactersB Reference process parametersC Logical Effort ToolsD Solutions