Optimierung und Performancesteigerung bei der Generierung von VHDL-Modellen analoger Schaltungen
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Sprache:Deutsch
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Beschreibung
Produktdetails
Einband
Taschenbuch
Erscheinungsdatum
19.08.2016
Abbildungen
1 Farbabb.
Herausgeber
Oliver TüngelerVerlag
GRINSeitenzahl
68
Maße (L/B/H)
21/14.8/0.6 cm
Gewicht
112 g
Auflage
1. Auflage
Sprache
Deutsch
ISBN
978-3-86943-133-8
Diplomarbeit aus dem Jahr 2007 im Fachbereich Informatik - Theoretische Informatik, Note: 1, Technische Universität Darmstadt, Sprache: Deutsch, Abstract: Diese Arbeit baut auf einem Programm auf, das einen analogen Schaltkreis in das entsprechende VHDL-Modell zur späteren formalen Verifikation überführt. Das Programm wurde an der Technischen Universität in Darmstadt im Fachbereich Rechnersysteme entwickelt und ist durch die Erfolge dieser Arbeit letztendlich einsatzbereit.
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