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Stress and Strain Engineering at Nanoscale in Semiconductor Devices

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Beschreibung

Produktdetails

Einband

Taschenbuch

Erscheinungsdatum

25.09.2023

Abbildungen

schwarz-weiss Illustrationen, Raster, schwarz-weiss, Zeichnungen, schwarz-weiss, Tabellen, schwarz-weiss

Verlag

Taylor & Francis

Seitenzahl

260

Maße (L/B/H)

23.4/15.6/1.5 cm

Gewicht

220 g

Sprache

Englisch

ISBN

978-0-367-51933-9

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Taschenbuch

Erscheinungsdatum

25.09.2023

Abbildungen

schwarz-weiss Illustrationen, Raster, schwarz-weiss, Zeichnungen, schwarz-weiss, Tabellen, schwarz-weiss

Verlag

Taylor & Francis

Seitenzahl

260

Maße (L/B/H)

23.4/15.6/1.5 cm

Gewicht

220 g

Sprache

Englisch

ISBN

978-0-367-51933-9

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  • Chapter 1. Introduction

    Chapter 2. Simulation Environment

    Chapter 3. Stress Generation Techniques in CMOS Technology

    Chapter 4. Electronic Properties of Engineered Substrates

    Chapter 5. Bulk-Si FinFETs

    Chapter 6. Strain-Engineered FinFETs at NanoScale

    Chapter 7. Technology CAD of III-Nitride Based Devices

    Chapter 8. Strain-Engineered SiGe Channel TFT for Flexible Electronics